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具有高速PE间数据再配置功能的处理器阵列系统

发明专利无效专利
  • 申请号:
    CN200780007663.4
  • IPC分类号:G06F15/173;G06F15/80;G06T1/20
  • 申请日期:
    2007-02-27
  • 申请人:
    日本电气株式会社
著录项信息
专利名称具有高速PE间数据再配置功能的处理器阵列系统
申请号CN200780007663.4申请日期2007-02-27
法律状态权利终止申报国家中国
公开/公告日2009-04-01公开/公告号CN101401088
优先权暂无优先权号暂无
主分类号G06F15/173IPC分类号G;0;6;F;1;5;/;1;7;3;;;G;0;6;F;1;5;/;8;0;;;G;0;6;T;1;/;2;0查看分类表>
申请人日本电气株式会社申请人地址
日本东京都 变更 专利地址、主体等相关变化,请及时变更,防止失效
权利人日本电气株式会社当前权利人日本电气株式会社
发明人京昭伦
代理机构中科专利商标代理有限责任公司代理人李香兰
摘要
一种处理器阵列系统,包括至少具有三个处理部件(PE)块的PE块阵列,该PE块包含M个PE,各PE块通过M条左连接线BO与其它的PE块连接,同时还通过M条右连接线B1与另外的PE块连接;上述PE块中所含有的上述PE包括:选择电路(LS),从连接距离M的各PE的1条上述左连接线B0和来自PE块内的其它PE的连接线之中选择1条信号线;选择电路(RS),从连接距离M的各PE的1条上述右连接线(B1)和来自PE块内的其它PE的连接线之中选择1条信号线;和用于从选择电路(LS)和选择电路(RS)的输出中选择1条信号线的单元;上述处理器阵列系统,进行如下这样工作,依据来自控制处理器的命令码,所有PE使用左连接线BO和右连接线B1,向M邻接的左和右的PE传输数据,同时在传输缓冲器中存储分别从右M连接和左M连接传送过来的数据。

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